Home > DA SHOW/CDNLive! Japan 2010
| 7/22(木) | ||||||||||||||||||||||||||||
| 10:00-12:00 | 基調講演 | |||||||||||||||||||||||||||
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| 12:00-13:00 | 昼食 | |||||||||||||||||||||||||||
| トラック | 機能検証/ システム設計 検証 |
フロント・エンド設計 | バック・エンド 設計/ 解析 |
カスタムIC設計 | SiP/Package設計 | |||||||||||||||||||||||
| 13:00-13:50 | EDA360/System Realizationを実現するTLM設計・検証ソリューション 日本ケイデンス 後藤 謙治 |
RC-DFT と Encounter Test の統合環境によるワンパス DFTフロー 日本ケイデンス 有馬 真一 |
SSTAを製品設計に活用するには 古茂田 道夫 氏 |
カスタムICテクノロジのロードマップの ご紹介 日本ケイデンス 浅利 和彦 |
Distributed Co-design 日本ケイデンス 永澤 康 |
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| 14:00-14:50 | ASICをもっと身近に GA-Estimator 富士通セミコンダクター(株) 古市 真也 氏 |
並列計算機向けインタコネクト制御LSI設計におけるConformal ECO適用例のご紹介 富士通(株) 細川 生人 氏 |
ライブデモ!! 日本ケイデンス 牧井 徹 池田 建善 上野 嘉之 |
IC61をベースにしたルネサスエレクトロニクスのアナログ/ミックスドシグナル設計生産性向上に対する取り組み ルネサス エレクトロニクス(株) 佐藤 貴雄 氏 |
EPSで生成したLSI電源モデルによるLSI-PKG-PCB協調設計 富士通VLS(株) 藤根 栄司 氏 |
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| 14:50-15:20 | コーヒー・ブレイク | |||||||||||||||||||||||||||
| 15:20-16:10 | 高位合成技術とエミュレータを活用したIP論理検証品質の改善 (株)日立製作所 横井 照典 氏 |
最新版RTL Compiler 10.1 アップデートと RTL Compiler の知らないと損をする機能のご紹介 日本ケイデンス 榎戸 芽久 |
Cadence/EDISベースの実用的なSTARC次世代DFM設計環境構築 ~ 次世代のDFM設計ではEDISを こう使う ~ (株)半導体理工学研究センター 田中 輝弥 氏 |
VirtuosoとEncounter間の親和性を高めたOpenAccess ベースのミックスシグナル設計環境のご紹介 富士通VLSI(株) 仲家 有紀子 氏 |
協調設計でフィジビリティは本当にできるのか? (株)東芝 セミコンダクター社 福場 義憲 氏 イノテック株式会社 鹿俣 丞 |
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| 16:20-17:10 | システムレベル設計・検証に対するケイデンスのテクノロジとソリューションとは? 日本ケイデンス 夏井 聡 |
RTL CompilerによるRTL構造解析と配線混雑防止手法 (株)リコー 飯島 健 氏 |
先端デバイスDFM対策はEDI Systemで! 日本ケイデンス 石渡 勝久 / 横山 和男 |
MATLAB & Simulinkによるアナログ/ミックスドシグナル設計 MathWorks Japan 竹本 佳充 氏 MEMSとICとの協調設計システム MEMS+ Coventor, Inc. 前木場 秀之 氏 |
Ansoft HFSSとCadence RF SiPの統合環境による、RF Module設計と解析フロー アンソフト・ジャパン(株) 門田 和博 氏 日本ケイデンス 南木 智美 |
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| 17:00-18:30 | ケイデンス・ビア・ステーション | |||||||||||||||||||||||||||
| * | 事前お申し込み時には、一番ご興味のあるトラックを1つお選びいただきますが、 他トラックのセッションにも当日ご参加いただくことができます。 ご希望の場合は、当日、各会場前までお越し下さい。 事前にお申し込みをいただきましたお客様が着席された後、当日ご希望のお客様をご案内いたします。 |
| * | 各トラックの座長には、ユーザー様ご発表セッションの進行をお願いしております。 |
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