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ブロックの配置・配線のとき、過度のガードバンドは面積と電力消費を増大させ、デザインの性能を低下させる可能性があります。ケイデンスのブロック・インプリメンテーション・テクノロジはプロセスを意識した解析を提供し、リゾグラフィ、CMPやランダム欠陥のような製造プロセスのばらつきでイールドや信頼性に悪影響を与える効果を検出します。ファウンドリと関連付けられた統計的な製造のモデルを使い、初めの設計の意図を尊重し、論理的な正確性を保ち、45nmまでの進んだノードをサポートし、使い易さ、大規模そしてパフォーマンスを提供します。
設計者がより正確なブロック・レベルの制約を生成し、トップレベルのタイミング、混雑度、電源の問題を早期にとらえ、より考慮されたIPやパッケージの選択を行い、繰り返しを削減する手助けをします。
Encounter Digital Implementation System は大規模で高性能のデジタル・インプリメンテーションに対し、単一でスケーラブルなマルチCPU可能の設計環境にて、ばらつきや製造を考慮した設計の収束、低消費電力、ミックス・シグナルのインプリメンテーション、統合されたサインオフのための完全なソリューションをお届けします。
スピードと容量を最高に保ちながらシグナル・インテグリティ、タイミングそしてDFMを考慮した配線を行います。DFMを考慮しながらインプリメンテーション・フェーズに移り、そこでエンジニアが最小のコストで最大の変更を行えるようにします。
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