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ケイデンスのCPF(Common Power Format)を使用した優れた低消費電力ソリューション・テクノロジは最先端のSOCに低消費電力設計のテクニックを容易に組み込めるようにします。
ケイデンスのInCyte Chip EstimatorはICサイズ、消費電力、リーク電流、性能の達成の可能性、そしてコストの正確な予測を可能とします。アーキテクチャの探索が可能になるため、ユーザはチップのインプリメンテーションの膨大なオプションを数値化して比較し、技術的および経済的にバランスの取れたゴールを予測することができます。統合された低消費電力のプランニング機能はCPFのオーサリングと生成機能を提供し、下流工程の低消費電力を考慮したツールをドライブします。
Encounter RTL Compilerのグローバル論理合成は最先端の低消費電力設計のために最高品質のシリコンを保証する一方で設計期間の短縮を実現します。また、Encounter RTL Compilerは設計者がCPFを使いさまざまな電力管理技術によるトレードオフ解析をする環境を提供し、そしてトップダウンにパワー・ドメインを意識した論理合成を行い、タイミング、電力、そしてエリアを同時に最適化します。
Encounter Conformal Low Power は等価性のチェック（テストベクタを使わず優れた性能、容量、そして使い易さを提供)と同時に、CPFから電力の設計仕様を理解して、構造や機能拡張されたチェック（低消費電力ストラクチャの適切な挿入と接続性の検証）を実行します。Encounter Conformal Low Power は トランジスタ・スタックを通したドライブ能力のチェック、そして電力が切れたときに思わぬ問題を起こすパワー・ドメインの境界をまたがったDCパスのような回路の問題をチェックします。また多電源多電圧（MSMV）、電源遮断(PSO)、グラウンドの遮断、そしてダイナミックな電圧と周波数のスケーリング（DVFS）のような高度な低消費電力の設計テクニックの検証をサポートします。
CPFに記述されている電力の設計仕様にもとづき、Encounter Test Architect は必要とされるパワー・ドメインとPSOの組み合わせに対し、自動的に個別のテストモードを生成します。特別の目的を持った‘テストを考慮した設計’(DFT)のストラクチャを挿入し、テスト時にPSOのコントロールを可能にします。電力を考慮した自動テストパターン生成 (ATPG) エンジンはレベルシフタやアイソレーション・セルのような低消費電力ストラクチャをターゲットにし、テスト時の消費電力を低減するために低消費電力スキャンベクタを生成します。これは低消費電力デバイスのテストに対して最高のテスト品質と最も少ない電力を実現します。
Encounter Digital Implementation System はPSOやMSVなどの複雑な低消費電力設計のためにパワースイッチやレベルシフタなどを挿入する高度に柔軟性を持ったコマンドを提供します。システムの自動クロックツリー合成機能とNanoRoute RouterはCPFから情報を読み、完全にパワー・ドメインを意識して実行されます。Encounter Power SystemとEncounter Conformal Low Power へのインターフェースは、CPFを使うことにより、Encounter Digital Implementation System との完全な統合環境を実現します。
Encounter Power System はフロアプラン、パワープラン、フィジカル・インプリメンテーション、最適化、そしてサインオフにわたって、一貫性があり、収束性の高いパワーとパワーレール解析を提供します。高品質で、簡単で、早期のパワーとパワーレール解析を求めているフロントエンドの論理設計者をサポートするだけではなく、総合的なサインオフ解析とシリコンとの互換性を求めるバックエンドのフィジカル設計者もサポートします。CPF主導のEncounter Power System がCPFを読み込むことにより、どんな低電力インプリメンテーションにも不可欠なもので、デカップリング・キャパシタやパワースイッチの最適化が可能となりリーク電流を減少させます。
Incisive verification management technologyは、人手による作業が困難な検証管理や、カスタム・ソフトウェアの開発が必要となるか、もしくは単純に人手では実行できないタスクの自動化を可能にします。Incisive Design Team Manager とIncisive Enterprise ManagerはCPFを読み込むことができ、自動的にパワーモードやパワーコントロール信号のカバレッジ解析を含むように検証プランを拡張し、電力に関連する全ての論理がの完全に検証されることを確実にします。
Incisiveシミュレータは設計フローの初期の段階で、ゲートレベルのネットリストを待つことなく、また大変な労力を要するモデリング・テクニックを開発することなく、設計者がいろいろなパワー・アーキテクチャを試すことができる環境を提供します。Incisive Design Team SimulatorとIncisive Enterprise Simulatorは挿入されたパワーマネージメント構造に起因する機能的な欠陥を捉え、過大な電力消費につながる可能性のあるバグを特定します。
Incisive Formal Verifier は標準のアサーション言語を使って電力の設計仕様の検証を可能にします。複雑なパワーコントロール・モジュール、ステート、そしてシーケンスの関係はCPFの仕様に対してすばやく検証され、コーナーケースは時間のかかるシミュレーションを実行することなく検証できます。
Incisive Palladium シリーズはソフトウェアとハードウェアの両方を含めシステムレベルの動作をエミュレーションし、複雑なPSOの関係をすばやく検証します。さらに、Incisive Palladium Dynamic Power Analysis (DPA) はダイナミックにピークと平均の電力を予測する、高スループット、サイクルアキュレート、そして効率的な方法を提供します。設計者は、さまざまな低消費電力設計やインプリメンテーションのシナリオを試行し、現実的な使用環境での消費電力への影響を決定することができるようになります。
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